NEC化合物デバイス試作プロセスセミナーのご案内

本年度NEC化合物デバイス 株式会社によるバイポーラプロセスの試作を行います。本プロセスでは、またCadenceのAnalog Design Environmentによる設計環境が供給されるほか、バイポーラトランジスタや保護回路などアクティブ素子のレイアウトはマクロとして与えられる予定です。したがって、複雑な高性能バ
イポーラトランジスタのレイアウトをユーザーは記述する必要はありません。また、NEC化合物デバイスで実際に市販されている高周波集積回路のレイアウトやシミュレーション用モデルも例としてご提示いただく予定ですので、これまでバイポーラ回路になじみのなかったユーザーにも、高性能なアナログ回路を手にすることができる絶好のチャンスです。

VDECでは、本試作プロセスを開始するにあたり、NEC化合物デバイス様によるプロセス紹介および設計フローについてのセミナーを行います。バイポーラトランジスタを使った回路に興味をお持ちの方には、セミナーにご参加の上、本プロセスへの参加をぜひご検討ください。

本プロセスの初回設計締切りは１０月下旬を予定しております。

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NEC化合物デバイス試作プロセスセミナーのご案内
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場　所：東京大学工学部9号館1階 大会議室
日　時：2002年8月27日(火) 10時00分〜17時(予定、昼休みを含む)
対　象：バイポーラプロセスの試作を検討されている方
　　　 （本セミナー参加後必ずしも試作を行なう必要はありませんが、受講に際して秘密保持
　　　　契約(NDA)をVDECと結んでいただく必要がありますので必ず教官の承認を得てお申し込
　　　　みください。）
定　員：20名程度
受講料：無料（ただし，会場までの交通費，宿泊費は各自負担）

セミナー内容：
デバイス・プロセスの紹介
デザイン・フローの紹介
設計ルールの説明
設計事例の紹介
デザイン・フローデモ

===== 申込方法 =====
以下に記入の上、藤島(fuji@ee.t.u-tokyo.ac.jp)まで電子メールでお申し込み下さい。

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御名前：
所属・研究室：
身分：
連絡先住所：
電話:
FAX：
E-Mail：
（学生の場合）
指導教官のお名前：
指導教官のメールアドレス：
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ご不明な点は、NECバイポーラプロセス担当のVDEC藤島(fuji@ee.t.u-tokyo.ac.jp)までご連絡ください．